Allegro 今日: 0|主题: 545|排名: 10

1 ... 17 18 19 202122 23 24 25 ... 28 / 28 页下一页

新窗全部主题最新热门热帖精华更多 \| 显示置顶		作者	回复/查看	最后发表


预览 [分享] PCB Layout中直角走线会产生什么影响?	boli505 2015-8-14	36501	carol8688 2015-9-8 10:14
预览在WIN10上安装16.3报如下错误，不知道哪位高手能帮忙解答一下	yeary_2012 2015-9-1	15056	yeary_2012 2015-9-1 20:10
预览 [求助] ALLEGRO 焊盘制作过程详解	boli505 2015-9-1	06378	boli505 2015-9-1 11:35
预览 [交流] 如何使用脚本删除规则里面的一些bus与差分对设置？	mengzhuhao 2015-8-29	26207	mengzhuhao 2015-8-29 22:10
预览 [分享] Cadence常见文件格式	boli505 2015-8-28	17254	hyxs714154 2015-8-28 16:30
预览 [交流] 关于allegro脚本编辑的一个问题：如果将约束管理器里面的网络层次全展开？	mengzhuhao 2015-8-28	04578	mengzhuhao 2015-8-28 00:46
预览 [分享] allegro软件通孔类焊盘制作方法及步骤	boli505 2015-8-24	18022	bingshuihuo 2015-8-26 14:44
预览 [分享] Allegro中针对铺铜不能自动更新	boli505 2015-8-20	110883	yeary_2012 2015-8-26 10:59
预览 [分享] pcb layout学习中用Allegro几个误区	boli505 2015-8-21	35033	yeary_2012 2015-8-26 10:54
预览 [求助] Cadence_SPB17.0 CIS database parts window 汉字乱码咋解决	wdhxy 2015-8-13	19741	wdhxy 2015-8-25 14:48
预览 DDR中的Bank是指的什么？	hyxs714154 2015-8-24	03311	hyxs714154 2015-8-24 12:06
预览这个VCC3V3 net走完线之后怎么还有鼠线，我吧Ratsnest_Schedule 关掉了还是去不掉？	hyxs714154 2015-8-22	26899	hyxs714154 2015-8-23 21:37
预览 [分享] ALLEGRO16.2出现问题“changes not saved, cannot update the env file”	boli505 2015-8-19	07635	boli505 2015-8-19 16:26
预览原理图这个算不算是个bug？为何复制后的坐标信息不能顺序？	mengzhuhao 2015-8-12	24861	mengzhuhao 2015-8-18 20:54
预览 [分享] PCB文件PROTEL到ALLEGRO的转换技巧	boli505 2015-8-18	04953	boli505 2015-8-18 11:16
预览问下DDR3也可以用T拓仆嘛,还是必须要用Fly-by菊花链拓仆？	hyxs714154 2015-8-13	88589	hyxs714154 2015-8-18 09:21
预览 BGA的Breakout区域是不是就是CM中要定义的Pin delay的长度呢？	hyxs714154 2015-8-17	25736	hyxs714154 2015-8-18 08:53
预览 [分享] cadence布线遇到问题3（生成光绘文件中断）	boli505 2015-8-17	05622	boli505 2015-8-17 17:24
预览 BGA扇出参数设置中pin-via space 没有中心这一项可选	yuhuikeji 2015-8-14	24898	hyxs714154 2015-8-17 13:28
预览 [分享] Protel 原理图/PCB到Cadence的数据转换	boli505 2015-8-14	15101	PLCC 2015-8-16 00:37

1 ... 17 18 19 202122 23 24 25 ... 28 / 28 页下一页

返回发新帖

账号		自动登录	找回密码
密码			立即注册

Allegro 今日: 0|主题: 545|排名: 10

快速发帖

浏览过的版块